- 8個のT1/E1 TDMポートをサポート
- 部分的なT1/E1をサポート
- ATM forum規格に準拠のT1とE1のATM
- ATMレイヤに対する標準UTOPIA IIインタフェース
- UTOPIAアドレス範囲設定可能
- Tx FIFO深さを2、3、または4セルに設定可能
- オプションの、ITU I.432に基づく、送信方向ペイロードスクランブリングと受信方向デスクランブリング
- オプションの、COSET多項式の加算のプログラマブルな送信方向HEC挿入
- HECベースのセル生成
- 受信方向の単一ビットHECエラー補正
- 受信HECエラーセルのフィルタリング
- 受信アイドル/割り当てのないセルのフィルタリング
- ユーザ定義セルのフィルタリング
- 8ビット多重化/非多重化、Motorola/Intel社マイクロプロセッサインタフェース
- 高速外部クロック不要の内部クロック発生器
- 1秒タイマ内蔵
- 割込みによる、最大8個の外部ステータス信号検出/レポート
- IEEE 1149.1 JTAGバウンダリスキャンをサポート
- 17mm x 17mmの256ピンCSBGA
|
|
|
|