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DS31256	이 제품은 새로운 설계에는 권장되지 않습니다.

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정오표

정오표 DS31256 31256B2.pdf 정오표 DS31256 31256A2.pdf

애플리케이션 노트

애플리케이션 노트 390: DS31256 and T1/E1 Interface - DS31256 애플리케이션 노트 392: DS31256 Gapped Clock Applications - DS31256 애플리케이션 노트 399: DS31256 Loopback Modes - DS31256 애플리케이션 노트 2867: Initialization Steps for the DS31256 - DS31256 애플리케이션 노트 2871: DS31256 HDLC Controller Step-by-Step Configuration—Configuration Mode - DS31256 애플리케이션 노트 2872: DS31256 HDLC Controller Step-by-Step Configuration—Bridge Mode - DS31256 애플리케이션 노트 3071: Internal Test Registers for the DS31256 - DS31256 애플리케이션 노트 3259: DS31256 -- 레지스터 덤프용 코드 예 - DS31256 애플리케이션 노트 3344: DS31256 -- T3/E3 MUX/DS3112 Hardware Connections - DS31256 애플리케이션 노트 3345: Examples of DS31256 Applications - DS31256 애플리케이션 노트 3347: DS31256 Unchannelized T3/E3/HSSI/VDSL Port Configuration for Bridge Mode Applications - DS31256 애플리케이션 노트 3475: DS31256 PCI Bus Utilization - DS31256 애플리케이션 노트 3760: Interleaved Bus Operation - DS31256 애플리케이션 노트 3818: Enabling Fractional-T1(FT1) Loopback Detection on the DS31256 - DS31256

디자인 가이드

Communications (PDF)

신뢰성 보고서

신뢰성 보고서: DS31256.pdf

소프트웨어/모델

DS31256_B1 BSDL 모델 DS31256_B2V BSDL 모델 DS31256 BSDL 모델 DS31256_A2 BSDL 모델 DS31256_B2 BSDL 모델 DS31256 Cadence Concept Symbol DS31256 Logical Symbol-XML Format DS31256 IBIS 모델

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