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DS1WM
동기화 가능한 1-Wire Bus Master


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데이터 시트
전체 데이터 시트 (PDF, 124kB)
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제품 설명
As more 1-Wire® devices become available, more and more users have to deal with the demands of generating 1-Wire signals to communicate to them. This usually requires "bit-banging" a port pin on a microprocessor, and having the microprocessor perform the timing functions required for the 1-Wire protocol. While 1-Wire transmission can be interrupted mid-byte, it cannot be interrupted during the "low" time of a bit time slot; this means that a CPU will be idled for up to 60 microseconds for each bit sent and at least 480 microseconds when generating a 1-Wire reset. The 1-Wire Master helps users handle communication to 1-Wire devices in their system without tying up valuable CPU cycles. Integrated into a user's ASIC as a 1-Wire port, the Verilog or VHDL core uses little chip area (3470 gates plus 2 bond pads).

This circuit is designed to be memory mapped into the user's system and provides complete control of the 1-Wire bus through 8-bit or single commands. The host CPU loads commands, reads and writes data, and sets interrupt control through six individual registers. All of the timing and control of the 1-Wire bus are generated within. The host merely needs to load a command or data and then may go on about its business. When bus activity has generated a response that the CPU needs to receive, the 1-Wire Master sets a status bit and, if enabled, generates an interrupt to the CPU. In addition to write and read simplification, the 1-Wire Master also provides a Search ROM Accelerator function relieving the CPU from having to perform the complex single-bit operations on the 1-Wire bus.

주요기능
  • Memory maps into any standard byte-wide data bus.
  • Eliminates CPU "bit-banging" by internally generating all 1-Wire timing and control signals.
  • Generates interrupts to provide for more efficient programming.
  • Search ROM Accelerator relieves CPU from any single bit operations on the 1-Wire Bus.
  • Capable of running off any system clock from 4MHz to 128MHz.
  • Small size: all digital design, only 3470 gates.
  • Applications include any circuit containing a 1-Wire communication bus.
  • Supports standard and overdrive 1-Wire communication speeds
  • Supports strong pull-up specifications.
  • Master available in both Verilog and VHDL
  • Supports single bit transmissions.
  • Provides added support for long line conditions.

다이어그램
DS1WM: Block Diagram
블록 다이어그램

애플리케이션 노트
  • 애플리케이션 노트 119: FPGA 또는 ASIC에서 1-Wire® Master 임베딩 - DS1WM
  • 애플리케이션 노트 120: API를 사용하는 DS1WM 1-Wire® 버스 마스터 제어 - DS1WM
  • 애플리케이션 노트 145: Interfacing the 1-Wire Master (DS1WM) to an ARM7 Processor - DS1WM
  • 애플리케이션 노트 214: Using a UART to Implement a 1-Wire Bus Master - DS1WM

    디자인 가이드
  • 1-Wire® Products (PDF)

    신뢰성 보고서
  • 신뢰성 보고서 요청:

    소프트웨어/모델
    없음

    주문 정보
    참고:

    1. 부품을 구매하기 위한 기타 옵션 및 링크는 http://korea.maxim-ic.com/sales에 실려 있습니다.
    2. 필요한 것을 찾지 못하셨나요? Maxim 애플리케이션 엔지니어에게 문의하십시오. 부품을 찾는데 필요한 전문가의 도움이 보통 업무일 1일 이내에 제공됩니다.
    3. 부품번호 suffix: T 또는 T&R = 테잎 앤 릴, + = RoHS/lead-free, # = RoHS/lead 예외.추가 정보: 전체 데이터 시트 또는 부품번호 규칙
    4. *일부 패키지는 크기 편차(variation)를 가지며 이 값은 도면 상에 제시되어 있습니다. “패키지 코드/편차”는 해당 제품이 사용하고 있는 편차를 보여줍니다. 부품번호 suffix에 "+", "#", "-"는 RoHS 준수 상태를 나타냅니다. 패키지 도면에 suffix 문자는 다를 수 있습니다.


    이 제품은 웹사이트에서 구매가 불가능합니다. 구매를 원하시면 당사로 문의해주십시오.


    추가 정보
  • 1-Wire 지원: http://support.maxim-ic.com/1-wire

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     EV 킷 

    2007-09-18
    이 페이지는 최근에 변경됨: 2009-10-23


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