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DS1005
5탭 실리콘 딜레이 라인


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제품 설명
The DS1005 5-Tap Silicon Delay Line reproduces an input logic state at the output after a fixed delay at five equally spaced taps, ranging from 12ns to 250ns. (See table.) Delay accuracy is characterized at ±3% or ±2ns (whichever is greater). Leading and trailing edges are reproduced with equal precision. Each tap is capable of driving up to ten 74LS loads.

By enabling precise timing adjustments, Dallas Silicon Delay Lines improve system performance. They provide an effective, economical solution to the designer working with the complex timing requirements of mismatched ASICs or other components, or with the strict timing tolerances of increasing system clock rates. Each delay line die is laser-optimized and molded into an auto-insertable DIP or space-saving SOIC package.

주요기능
  • All-silicon timing delay circuit
  • 5 taps, equally spaced
  • Delay tolerance +2ns or ±3%, whichever is greater
  • Leading and trailing edge accuracy
  • Low-power CMOS with TTL compatibility
  • Vapor phase, IR, and wave-solderability

Key Specifications:   Delay-Lines (Non-Programmable)
Part Number Functions Number of Taps Available Total Delays (ns) Supply Voltage (V) Variation in Supply Voltage RoHS Available Package Price**
DS1005 
Tapped
5 60 to 250 5 ±5% Yes PDIP/14
PDIP/8
SOIC/16
$2.85 @ 1k
See All Delay-Lines (Non-Programmable) (9)
Notes:
**This pricing is BUDGETARY, for comparing similar parts. Prices are in U.S. dollars and subject to change. Quantity pricing may vary substantially and international prices may differ due to local duties, taxes, fees, and exchange rates. For volume-specific prices and delivery, please see the price and availability page or contact an authorized distributor.

애플리케이션 노트
  • 애플리케이션 노트 229: Delay Lines Comparison - DS1005
  • 애플리케이션 노트 592: Silicon Timed Circuits: Frequently Asked Questions - DS1005, DS1005
  • 애플리케이션 노트 879: Tech Brief 30: Skew Correction Using Delay Lines - DS1005
  • 애플리케이션 노트 880: Tech Brief 31: Using Delay Lines to Generate Multi-Phased Clocks - DS1005
  • 애플리케이션 노트 979: Tech Brief 36: Building a Pulse Width Discriminator Using a Delay Line - DS1005
  • 애플리케이션 노트 983: Tech Brief 37: Replacing Passive Hybrid Delay Lines with All-Silicon Delay Lines - DS1005

    EV 킷
    없음

    디자인 가이드
  • SYSTEM TIMING & CONTROL (PDF)

    신뢰성 보고서
  • 신뢰성 보고서: DS1005.pdf

    소프트웨어/모델
    없음

    주문 정보
    참고:

    1. 부품을 구매하기 위한 기타 옵션 및 링크는 http://korea.maxim-ic.com/sales에 실려 있습니다.
    2. 필요한 것을 찾지 못하셨나요? Maxim 애플리케이션 엔지니어에게 문의하십시오. 부품을 찾는데 필요한 전문가의 도움이 보통 업무일 1일 이내에 제공됩니다.
    3. 부품번호 suffix: T 또는 T&R = 테잎 앤 릴, + = RoHS/lead-free, # = RoHS/lead 예외.추가 정보:전체 데이터 시트또는 부품번호 규칙
    4. * 일부 패키지는 크기 편차(variation)를 가지며 이 값은 도면 상에 제시되어 있습니다. “패키지 코드/편차”는 해당 제품이 사용하고 있는 편차를 보여줍니다. 부품번호 suffix에 "+", "#", "-"는 RoHS 준수 상태를 나타냅니다. 패키지 도면에 suffix 문자는 다를 수 있습니다.


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    DS1005C-501  
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    DS1005M-250  
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    DS1005S-175  
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    DS1005S-150/T&R/  
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    DS1005S-175+  
    SOIC,16 핀,
    도면: 21-0042B (PDF)
    패키지 코드/편차 이용: W16+2*
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    DS1005S-125+  
    SOIC,16 핀,
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    DS1005S-75+  
    SOIC,16 핀,
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    DS1005S-200+T&R  
    SOIC,16 핀,
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    재료 분석
    DS1005S-200  
    SOIC,16 핀,
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    재료 분석
    DS1005S-100  
    SOIC,16 핀,
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    패키지 코드/편차 이용: W16-2*
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    DS1005S-250  
    SOIC,16 핀,
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    DS1005S-150  
    SOIC,16 핀,
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    DS1005S-60  
    SOIC,16 핀,
    도면: 21-0042B (PDF)
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    0°C ~ +70°C RoHS/Lead-Free: 아니오
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    DS1005S-75  
    SOIC,16 핀,
    도면: 21-0042B (PDF)
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    0°C ~ +70°C RoHS/Lead-Free: 아니오
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    1999-11-17
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